혹시 verilog hdl (quartus툴) 질문가능한지요..?(본삭금

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게시물ID : computer_247210짧은주소 복사하기
작성자 : 건빵봉지★
추천 : 0
조회수 : 399회
댓글수 : 3개
등록시간 : 2015/06/23 04:47:24

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wire와 reg 선언에 대해 너무나도 햇갈립니다 ㅠㅠ

reg은 레지스터의 출력값에대해 선언해준다고 알고있는데, 만약 이값이 또 다른 레지스터의 입력으로 들어간다면

wire선언을 해줘야하나요 reg선언을 해줘야하나요...? 지금 코딩하고있는데 두개 다하면 오류가뜨고.. 감이 잘 안잡히네요..

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